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陈岚

作品数:13 被引量:55H指数:4
供职机构:中国科学院计算技术研究所更多>>
发文基金:国家自然科学基金江苏省科技成果转化专项资金更多>>
相关领域:电子电信自动化与计算机技术经济管理更多>>

文献类型

  • 12篇期刊文章
  • 1篇会议论文

领域

  • 9篇电子电信
  • 3篇自动化与计算...
  • 1篇经济管理

主题

  • 3篇低功耗
  • 3篇无线
  • 3篇无线局域
  • 3篇无线局域网
  • 3篇局域
  • 3篇局域网
  • 3篇功耗
  • 2篇电路
  • 2篇信号
  • 2篇信号完整性
  • 2篇亚微米
  • 2篇译码
  • 2篇译码器
  • 2篇软判决
  • 2篇深亚微米
  • 2篇维特比
  • 2篇维特比译码
  • 2篇维特比译码器
  • 2篇物理综合
  • 2篇理综

机构

  • 10篇中国科学院
  • 5篇苏州中科集成...
  • 4篇桂林电子工业...
  • 2篇中国科学院研...
  • 1篇西安微电子技...

作者

  • 13篇陈岚
  • 4篇刘秉坤
  • 3篇王华
  • 2篇廖巨华
  • 2篇唐志敏
  • 1篇刘力轲
  • 1篇任鸣放
  • 1篇沈绪榜
  • 1篇马鸿开
  • 1篇郭雅琳
  • 1篇陈磊

传媒

  • 5篇微电子学与计...
  • 3篇中国集成电路
  • 1篇电讯技术
  • 1篇计算机研究与...
  • 1篇计算机工程
  • 1篇计算机工程与...
  • 1篇第十四届全国...

年份

  • 4篇2007
  • 2篇2006
  • 3篇2005
  • 1篇2003
  • 2篇2002
  • 1篇1998
13 条 记 录,以下是 1-10
排序方式:
基于改进FFT算法的OFDM调制/解调模块设计被引量:7
2005年
文章对传统FFT算法进行了改进,改进后的算法将N点DFT分解成二维姨N点DFT的组合,在结构上更适合于用流水线方式实现FFT。文章首先对算法进行了推导,然后基于该算法设计了一个64点、32位字长的定点IFFT/FFT模块,用于802.11a中OFDM的调制/解调。与传统的流水线FFT比较,该模块中的复数乘法运算全部采用移位相加操作完成,因而消除了乘法器及旋转因子ROM的使用,降低了功耗。最后,对该模块进行了验证仿真。结果表明,在流水线饱和的情况下,该模块完成一个64点的FFT运算只需要8个时钟周期,在20MHZ时钟频率下,该模块的功耗为0.26W,完全能满足移动通信中对于高速度、低功耗的要求。
廖巨华陈岚
关键词:正交频分多路复用流水线低功耗
39届设计自动化会议EDA工具展观后
2002年
设计自动化会议DAC(Design Automation Conference)是集成电路行业最重要的国际技术会议之一。会议内容覆盖集成电路设计、验证方法、EDA技术、硅加工技术、IP技术以及微电子行业的未来发展趋势等。与DAC同时举行的EDA工具展览会;汇聚了全世界各先进的EDA厂商。DAC技术专题的内容可以从DAC的会议论文集中了解。本文主要介绍本次EDA工具展览会的情况,以及根据目前EDA工具的发展,展望集成电路技术未来的发展趋势。
陈岚
关键词:DACSOC
低功耗软判决维特比译码器的设计
本文提出了有别于IEEE802.11a标准的解码方法,将软判决译码使用在标准卷积码的解码机制上,利用算术部件的重组合和混合向后追溯式以及时钟关断技术,在保证性能和低复杂度前提下减少存储器读写操作以降低功耗,利用SMIC0...
刘秉坤王华陈岚
关键词:维特比译码器译码器设计无线局域网
文献传递
VLSI版图DRC验证算法的优化被引量:6
2007年
介绍了版图验证的几种方法:扫描线算法和层次化验证算法,并比较其优缺点,最后着重介绍了层次式与扫描线综合验证算法,并在SUN工作站上用C++实现。
郭雅琳陈岚
关键词:版图验证扫描线算法VLSI
单片系统(SoC)设计技术被引量:31
2002年
集成电路技术在近 10年里有了飞速的发展 ,加工工艺从 0 .5μm ,0 .6μm亚微米级工艺发展到 0 .2 5μm ,0 .18μm甚至 0 .1μm的深亚微米 (DSM)和超深亚微米级工艺 (VDSM) .单芯片集成度大大提高 ,加上集成电路设计的多年积累 ,单个芯片有能力实现复杂系统 ,这就是单片系统 (system on a chip) .在单芯片上实现复杂系统不是简单地将过去的设计在同一芯片上简单的集成 ,需要考虑许多新的技术问题 .将介绍单片系统的设计特点以及涉及单片系统设计的关键技术 ,其中包括设计复用技术、使用 IP核的注意事项以及端口标准化等问题 ;深亚微米设计的设计要点和难点 :深亚微米电路的电学模型以及连线延迟计算方法和避免传输线效应的方法 ;同时还将介绍单片系统的测试技术和一些测试方案 ,物理综合概念和目前流行的能提供深亚微米设计能力的主流
陈岚唐志敏
关键词:单片系统可测试性设计物理综合集成电路
高性能升余弦滤波器设计被引量:2
2006年
给出了一种适用于PHS基带系统中的高性能成形滤波器,对比两种实现方法在基带芯片中的性能,利用最少的非零比特位来表示符号数的编码技术即符号数(Canonic Sign D igit,CSD)。采用子结构共享技术改进数字滤波器结构,实现了2进制补码与CSD的转换和系统中升余弦Nyquist成形滤波器的ASIC设计,在TSMC 0.18μm工艺下进行了功能仿真、综合和后仿真。
刘秉坤王华陈岚
关键词:PHS基带系统升余弦滤波器
基于单元生成树的半定制基片组装算法
1998年
本文介绍了一种基于结构单元生成树的半定制基片的自动生成算法。该算法较之常规的算法突出了灵活多样的特性。采用这种算法,可以根据厂家的要求开发不同设计风格的半定制基片。该算法的时间复杂度为O(n),其中n为结构单元的类型数。
陈岚沈绪榜
关键词:集成电路
一次通过的物理综合流程的设计实例——龙芯1的设计流程建立
2003年
本文介绍了一个基于 Cadence 物理综合工具的一次通过深亚微米设计流程。在流程中,重点考虑了高性能系统设计的时序收敛问题,深亚微米设计中的连线延迟、信号串绕以及精确的时序分析等问题。通过对科学院重大创新项目以及863重点项目支持的高性能 CPU(龙芯1)的设计和流片,对该流程的可行性进行了验证。龙芯1一次流片成功,主频达到了266MHz,符合最初的时序要求。
陈岚唐志敏
关键词:龙芯信号完整性分析波形分析逻辑综合深亚微米物理综合
低功耗软判决维特比译码器的设计被引量:6
2007年
维特比译码器是广泛使用的极大似然解码方法。该文提出了有别于IEEE802.11a标准的解码方法,将软判决译码使用在该标准卷积码的解码机制上,利用算术部件的重组和混合向后追溯式以及时钟关断技术,在保证性能和低复杂度前提下减少存储器读写操作以降低功耗,利用SMIC0.18μmCMOS工艺设计实现该译码器,在ALTERAFPGA上实现原型验证,性能满足IEEE802.11a标准要求。
金文学刘秉坤陈岚
关键词:维特比译码器无线局域网低功耗软判决
一种快速的低压降电源/地网络设计方案被引量:2
2007年
在税控机SoC的物理设计中,对电源/地网络的设计流程做了较大地改进,提出了一种基于布线密度的设计方法:首先根据目标电压降确定各层金属电源/地线的布线密度,然后根据密度可有针对性的构架电源/地网络,大大提高了设计速度。另外,为降低占用了大量布线资源的电源/地网络对信号布线的不利影响,还对电源/地网络的布线宽度、间距和构架方式进行优化,提出了线宽、间距的计算公式,有效降低了设计的布线拥塞。最终实现了极低的电压降。
陈磊陈岚
关键词:电压降物理设计
共2页<12>
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